A3R1GE30JBF-8E

Zentel Japan
155-A3R1GE30JBF-8E
A3R1GE30JBF-8E

メーカ：

詳細：
DRAM DDR2 1Gb, 128Mx8, 800 at CL5, 1.8V, FBGA-60

データシート:
ECADモデル:
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在庫：
在庫なし
工場リードタイム：
12 週間 工場生産予定時間。
最小: 1   倍数: 1
ユニット価格:
¥-
合計 額:
¥-
EST関税:

価格 (JPY)

数量 ユニット価格
合計 額
¥1,222.5 ¥1,223
¥1,137.7 ¥11,377
¥1,103.5 ¥27,588
¥1,077.4 ¥53,870
¥1,051.4 ¥105,140
¥1,017.1 ¥254,275
¥991 ¥495,500
¥966.6 ¥966,600
2,420 見積り

製品属性 属性値 属性の選択
Zentel Japan
製品カテゴリー: DRAM
RoHS:  
SDRAM - DDR2
1 Gbit
8 bit
400 MHz
FPGA-60
128 M x 8
400 ps
1.7 V
1.9 V
0 C
+ 85 C
DDR2
Tray
ブランド: Zentel Japan
水分感度: Yes
取り付け様式: SMD/SMT
製品タイプ: DRAM
工場パックの数量: 2420
サブカテゴリ: Memory & Data Storage
供給電流 - 最大: 70 mA
トレードネーム: Zentel Japan
単位重量: 158 mg
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選択した属性: 0

データシート

コンプライアンスコード
USHTS:
8542320032
ECCN:
EAR99
原産地分類
原産国:
台湾
組立原産国:
入手不可
拡散国:
入手不可
出荷時に原産国または地域が変更される場合があります。

DDR2 SDRAM

Zentel DDR2 SDRAM features a double-data-rate architecture with two data transfers per clock cycle. The high-speed data transfer is realized by the 4 bits prefetch pipelined architecture. A bi-directional differential data strobe (DQS and /DQS) is transmitted/received with data for capturing data at the receiver. DQS is edge-aligned with data for READs; center-aligned with data for WRITEs Differential clock inputs (CK and /CK). The DLL aligns DQ and DQS transitions with CK transitions.

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